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1. 疫情期间，闲来无事搞了套射频开发板 12/3024 RF/无线 2020-02-29
  
  顶一个，学习学习中。。。
2. 时序约束出现问题 5/3232 FPGA/CPLD 2019-08-05
  
  SDC语句加指令 -add，防止抹掉之前的Clock Assignment。
3. 我在altera15下的第一个基于qsys的 nios2程序运行成功了 4/4333 FPGA/CPLD 2019-02-25
  
  感谢分享！学习中{:1_99:}{:1_99:}{:1_99:}

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