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1. LTspice仿真PMOS管，输出不应该是0V吗？ 4/803 ADI · 世健工业技术 2024-12-04
  
  beyond_笑谈发表于 2024-12-3 22:22 输出端没有负载，所以这个测量的电压是浮电压，C6两端并联一个电阻负载再测量一下
  是这个原因，感谢大佬
2. Altera DE1-SOC培训教材 545/95917 FPGA/CPLD 2016-03-08
  
  顶一下
3. 通过以太网口实现PC机与FPGA的通信问题 22/17640 FPGA/CPLD 2016-01-17
  
  fpga带的网口，所以是FPGA+phy,
4. FPGA作为SPI从机，如何读取数据，如何编程实现，请大神指点一二 6/5909 FPGA/CPLD 2015-12-15
  
  FPGA侧得由中断申请信号:)

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