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乱码部分可能是中文注释,目前有些比较老的版本还不支持中文输入,我想大概是这个原因吧~
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你把警告的原文贴出来看看吧~~
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恩,不错,谢谢版主分享~
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2012-02-16昨天参加以前一个部门的散伙饭,喝酒喝得头晕,今天上班完全没有状态,看来做研发平常真不能随便喝酒呀~:Sad:
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这个管脚你是希望怎样触发呢?上升沿?下降沿?高电平?低电平?还是其他什么条件触发?
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下载之后留个名儿~
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这个资料不错,谢谢楼主分享~
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正在阅读中,期待好文章哈哈~~
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最近刚好准备参加面试,版主您太给力了呀!~还有木有更多的题目呢?~
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先下载下来看看,谢谢楼主呀~
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貌似较有规模的公司作研发用这个比较多吧~只能友情顶一个了哈哈~
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一听这么介绍,立马有兴趣下来看看了哈哈~
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非常感谢楼主呀~哈哈
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谢谢楼主,我刚完成了一段代码,虽说是自己构思写的,但是却从来没有好好的打理思路,总是想到一点写一点,导致我现在看自己的代码的时候都不能好好的去理解代码,如果再等段时间的话,估计自己代码的很多东西就看不太明白了,看了楼主的话,我觉得很有必要在最近为我这段代码理个完整的思路,说不定还能找到思路中的一些缺陷呢~
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收了,谢谢楼主~~
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哦~~明白了~不过我这个是状态机的某一状态,应该问题不大吧?因为我用signaltap仿真出来的波形都没有问题的~
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夏老师的《verilog数字系统设计教程》入门的话很好用的哈哈~
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恩,支持!~每天在eeworld可以学习很多东西~
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恩,可以的,谢谢斑竹,我后来思路又绕回来了,应该用的就是您说的这种方法~
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一直想学习FIFO的相关东西,谢谢楼主分享~