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1. 上海贝尔 PCB 设计规范.pdf 238/53156 PCB设计 2013-12-17
  
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2. 整理的步进电机小知识问答 491/73700 工业自动化与控制 2013-09-30
  
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3. 无线充电技术将成为主流今年开始批量出货 870/117568 消费电子 2013-09-04
  
  看看学习下
4. / 单片机 2013-08-28
  
  学习下
5. TI 工程师《电源设计经验谈》1---50合集电子书 1086/99980 模拟与混合信号 2013-08-22
  
  下来学习学习下
6. TI 电源培训系列电子书---开关电源基础知识 849/86446 模拟与混合信号 2013-08-22
  
  最近正在学电源，学习学习
7. 你的心理承受能力足够大吗？ 45/6300 聊聊、笑笑、闹闹 2013-05-07
  
  ........................
8. 一道测试题教你一个终身受用的小哲理 780/92381 工作这点儿事 2013-04-22
  
  这么神秘，看看
9. 电子工程师必备手册(三)—EMIEMC设计秘籍 22/10783 嵌入式系统 2013-03-14
  
  看下学习学习
10. DC-DC 开关管瞬态电流由什么决定的？ 5/5563 电源技术 2013-03-13
  
  为什么会产生瞬态电流呢，是因为开关导通的时候对LC充电的原因所以导致瞬间电流很大？
11. DC-DC升压电路原理与应用(完整) 1115/114050 模拟与混合信号 2013-02-27
  
  学习学习
12. 开关电源电路图讲解。多图！！！ 233/33169 能源基础设施 2013-02-27
  
  学习学习学习
13. 关于时序约束 7/3709 FPGA/CPLD 2012-08-27
  
  多谢指导，另外我一直不明白的是，FPGA驱动外设，知道外设的时序，但是根据这个时序怎样来设置FPGA的约束条件？
14. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/767085 FPGA/CPLD 2012-08-23
  
  夏老师，您好，一直以来对时序分析都不是很理解，现在碰到这样的情况：两个信号同时进入到CPLD，但是各自经过的不同的逻辑后从管脚出来，导致两个信号有时间差，为了使两个信号能够同时出来，是不是加时序约束可以解决？来控制两个信号的布线，让他们尽可能同步出来？
15. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/767085 FPGA/CPLD 2012-03-01
  
  夏老师：您好！我现在利用CPLD来扩展CPU的IO口，CPLD无时钟，只是作为一个受CPU控制的从器件，类似373这种，通过数据线、地址线、控制线来扩展，我怎么才能知道CPLD与CPU通信的最快速度是多少？这应该看CPLD哪方面的参数呢？
16. 已经笑死9999个了,您千万不要做第10000个！ 397/52260 聊聊、笑笑、闹闹 2012-02-24
  
  kankanakankanak
17. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/767085 FPGA/CPLD 2011-10-29
  
  谢谢夏老师讲的这么详细！看来我基础知识不太牢固，还得多学习学习学习！
18. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/767085 FPGA/CPLD 2011-10-28
  
  夏老师，您好！ FPGA/CPLD中有两种常用电平，LVTTL3.3V 和LVCMOS 3.3V，从芯片的说明文档看输入输出电压，这两种电平可以互相驱动，不知道这两种电平具体有什么区别？设置成3.3V LVTTL，则IO口就是由三极管构成？设置成3.3V LVCMOS，IO口就是由MOS管构成？
19. 关于CPLD结构、布线方式 3/3647 FPGA/CPLD 2011-09-29
  
  CPLD内部采用固定长度的金属线进行各逻辑块的互连，所以设计的逻辑电路具有时间可预测性,这个固定长度的金属线怎么理解呢？
20. 关于CPLD结构、布线方式 3/3647 FPGA/CPLD 2011-09-29
  
  CPLD内部采用固定长度的金属线进行各逻辑块的互连，所以设计的逻辑电路具有时间可预测性,这个固定长度的金属线怎么理解呢？

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