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1. 用FPGA实现高精度时间间隔测量 37/13261 FPGA/CPLD 2016-05-31
  
  :time::time::time::time::time::time:
2. 多个PLL使用的问题 15/9399 FPGA/CPLD 2016-04-09
  
  请问这个问题怎么解决的？:time:
3. 430与TDC的SPI通信问题 2/3251 微控制器 MCU 2016-03-02
  
  进展的怎么样了？:)
4. 【Altera SoC】基于SOPC的单通道TDC设计（4） 13/168160 FPGA/CPLD 2015-12-23
  
  coyoo 发表于 2015-12-19 11:34 你是那个？
  你的铁杆粉哈哈
5. 炼狱传奇-音乐播放器之战 5/3951 FPGA/CPLD 2015-12-18
  
  :time::time::time::time::time:
6. ＃8月原创＃基于FPGA的TDC那些事之自动校准 9/7607 DIY/开源硬件专区 2015-12-18
  
  :):):):)
7. 【Altera SoC】基于SOPC的单通道TDC设计（4） 13/168160 FPGA/CPLD 2015-12-17
  
  coyoo 发表于 2015-9-6 15:36 楼主已经说的很清楚了，即进位链延时过短，已经“过犹不及”了；CV无法在逻辑运行更高的TDC时钟，否则就 ...
  王老师？:loveliness:
8. 【Altera SoC】基于SOPC的单通道TDC设计（3） 4/5871 FPGA/CPLD 2015-12-17
  
  :time::time::time::time:
9. 【Altera SoC】基于SOPC的单通道TDC设计（4） 13/168160 FPGA/CPLD 2015-12-17
  
  coyoo 发表于 2015-9-6 15:36 楼主已经说的很清楚了，即进位链延时过短，已经“过犹不及”了；CV无法在逻辑运行更高的TDC时钟，否则就 ...
  求大神指导:):)
10. 【Altera SoC】基于SOPC的单通道TDC设计（2） 9/4429 FPGA/CPLD 2015-12-17
  
  {:1_103:}{:1_103:}{:1_103:}{:1_103:}
11. 【Altera SoC】基于SOPC的单通道TDC设计（1） 2/5024 FPGA/CPLD 2015-12-17
  
  :):handshake:handshake

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