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1. 有没有哪位大神做过光栅数据采集 5/1459 FPGA/CPLD 2019-05-24
  
  光栅对数据的采样率貌似不高，应该还需要一个扫频系统，不知道是不是这个意思。
2. “我和intel SoC FPGA”+ 搞不懂的arm硬核开发 5/6339 FPGA/CPLD 2019-05-13
  
  我也有这块板子，跟你一样，照着小梅哥的教程学习。。
3. 请问如何用verilog实现一个迭代方程呀? 9/5587 EE_FPGA学习乐园 2019-03-03
  
  前提你得用Xilinx家的7系列fpga
4. 请问如何用verilog实现一个迭代方程呀? 9/5587 EE_FPGA学习乐园 2019-03-03
  
  用Vivado HLS很容易实现
5. 帮忙推荐一下板子 13/2738 FPGA/CPLD 2019-02-22
  
  用深度学习处理视频，zynq7020只能算刚刚入门，甚至入门的门槛都没到，真要实现的话，至少要用zynq Ultrascale系列
6. 哪位大神帮忙用FPGA设计两个窄脉冲模块酬金8K 3/2870 FPGA/CPLD 2018-08-09
  
  多加个零都不一定够～
7. 关于Xilinx JTAG下载器 34/22418 FPGA/CPLD 2018-01-18
  
  phdwong 发表于 2018-1-18 09:05 支持Xilinx 支持Altera 基本没什么固件成本50块，到时候开源
  火前留名，期盼楼主的杰作。
8. 关于Xilinx JTAG下载器 34/22418 FPGA/CPLD 2018-01-13
  
  同问，楼主有多余的么？
9. 【ST板卡来了（上）】温故知新：回顾 ST 2017 Roadshow，洞悉电子界技术新潮流 59/19524 单片机 2017-11-13
  
  答题成功，抽奖结果谢谢参与/
10. DE1SOC Linux系统支持图像和音频 3/4311 Altera SoC 2017-08-17
  
  厉害呀，前排留名
11. DE1-SoC怎样改变显示分辨率？ 8/3134 Altera SoC 2017-07-27
  
  alphalovelife 发表于 2017-7-27 13:24 1.altera_vip（qsys中 IP 核） 2.dts （设备树文件） 3.altera_framebuffer配置（make menuconfig）
  楼上言之有理，看来对于de1 soc了解得相当范到位
12. DE!_SoC开发板控制ADC 4/2802 Altera SoC 2017-07-06
  
  xiyanghong 发表于 2017-7-5 12:28 哈哈，不会说一百二百的
  我已经做出来了，结合了ADC和QSYS下的自定义IP核，自动控制ADC转换，并将转换结果自动通过H2F_AXI总线转存至HPS端的DDR3内存中，然后linux下通过QT读取这段内存，并波形显示结果。
13. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-06-30
  
  cncqzxj 发表于 2017-6-29 16:02 多谢了，要不直接发我的邮箱。另外想请教一下QT安装问题，我先是按照Altera的文档DE1_SoC_Control_Panel. ...
  由此看来，同时会fpga和linux的人真不多，好多问题都是要么linux不懂，要么fpga不懂，就卡在那里了。我觉得这也是soc入门那么难的一个原因。
14. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-06-30
  
  cncqzxj 发表于 2017-6-29 16:02 多谢了，要不直接发我的邮箱。另外想请教一下QT安装问题，我先是按照Altera的文档DE1_SoC_Control_Panel. ...
  这个简单，我给你个工具链，然后qmake直接用controlpanel里面提供好的，这样和板子上的一致，同时也省去了编译的过程。其实问题很简单，还有尽量使用sudo命令，那样可以省去很多权限的问题。
15. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-06-28
  
  cncqzxj 发表于 2017-6-26 11:07 原来你也在做这方面的事，要不多交流交流。我这几天还在学QT呢。
  恩，行，我可以把做好的给你发一份。
16. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-06-25
  
  cncqzxj 发表于 2017-6-18 21:53 多谢关心，今天才算是真正实现了。这SoC开发磕磕绊绊的事太多了。
  我做出来了，adc数据转存到linux内存空间，并通过qt显示采集的波形。
17. DE1_SOC如何访问HPS端DDR3中固定的某段地址范围 3/4230 Altera SoC 2017-06-25
  
  cncqzxj 发表于 2017-6-23 11:10 确实可以，我前几天刚做过。具体如下： int fd = open( "/dev/mem", ( O_RDWR | O_SYNC ) ) ; Buf_vBase ...
  好了，设计做出来了
18. DE1_SOC如何访问HPS端DDR3中固定的某段地址范围 3/4230 Altera SoC 2017-06-23
  
  cncqzxj 发表于 2017-6-23 11:10 确实可以，我前几天刚做过。具体如下： int fd = open( "/dev/mem", ( O_RDWR | O_SYNC ) ) ; Buf_vBase ...
  恩，好的，谢谢你。终于有回复了。
19. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-06-01
  
  cncqzxj 发表于 2017-5-23 23:11 还真是这里的问题。非常感谢STM32F103。可这是什么原因？这个总线选的是32位哟
  现在突发传输能够传输起来么？你想做的AD采集到的数据传输至Linux的内存空间，实现了么？
20. 求助：Aavlon MM问题 17/4954 Altera SoC 2017-05-23
  
  cncqzxj 发表于 2017-5-22 14:57 文件较大，超过15M限制，分为4部分，这是第4部分其中HW是FPGA工程，SW是HPS端的测试程序，内核模块就用 ...
  解决方法如下，将Avalon-MM中的Parameters参数中的Address units更改为SYMBOLS，并且将Bits per symbol更改为8。更改完成以后，在QSYS中按下F5，刷新整个系统，然后generate，即可生成成功。

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