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    1. 请教，如何求两个周期脉冲的时间差 12/7916 FPGA/CPLD 2011-06-10
      A脉冲T0控制，有P1.0入，B脉冲有P1.1入，当检测到P1.0发生上升沿跳变，T0开始计时，同时检测P1.1的跳变情况，当出现上升沿跳变，便终止T0计时，这时你便可以有设定的T0初值和T0终止时的值做差计算得到t。当然你设定T0初值可以简单设为0，便于计算。至于检测端口，用软件实现就可以，if while 等语句，如果单片机具有捕捉功能更简单了。检测时有两种情况考虑，检测到高电平和检测到低电平。如果你的脉冲占空比知道，就不需要考虑这两种情况了，只需要在检测到下降沿跳变时，终止T0,计算t时再加上低电平持续时间即可。
    2. 这个稍微有点档次了：解析 STM32 的启动过程 1541/187418 stm32/stm8 2011-06-10
      得加紧学习了

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