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1. 【Altera SoC体验之旅】+ 正式开启OpenCL模式 26/25449 FPGA/CPLD 2015-04-03
  
  第一篇在DE1 -SOC上介绍OPENCL实际操作的文章，虽然都是例子，但是熟悉过程很有指导意义
2. 【Altera SoC体验之旅】SOC初体验之HPSFPGA 43/20783 FPGA/CPLD 2015-04-02
  
  一个不错的教程
3. Altera DE1-SOC培训教材 545/97916 FPGA/CPLD 2015-03-19
  
  下载学习下
4. 怎么仿真带microblaze的ISE项目 4/8109 FPGA/CPLD 2013-05-24
  
  把XPS里的仿真PATH改成释放库路径就能解决
5. 有用FPGA实现framBuffer的吗 11/4949 FPGA/CPLD 2010-01-27
  
  用verilog语言或者VHDL写个SDRAM或者DDR(1,2,3) SDRAM控制器,输出信号再经驱动LCD模块,最后输出至LCD屏.如果不想写SDRAM控制器,可直接用带SDRAM controller 的IP核的FPGA器件即可. 总的来说实现还是有点难度,即使实现了要实现高速帧率也是值得研究的.呵呵
6. 有用FPGA实现framBuffer的吗 11/4949 FPGA/CPLD 2010-01-27
  
  用verilog语言或者VHDL写个SDRAM或者DDR(1,2,3) SDRAM控制器,输出信号再经驱动LCD模块,最后输出至LCD屏.如果不想写SDRAM控制器,可直接用带SDRAM controller 的IP核的FPGA器件即可. 总的来说实现还是有点难度,即使实现了要实现高速帧率也是值得研究的.呵呵

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