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    1. xilinx RAM Block "ENA" 问题? 9/6895 FPGA/CPLD 2012-10-04
      原帖由 仙猫 于 2012-10-4 07:53 发表 [url=https://bbs.eeworld.com.cn/redirect.php?goto=findpost&pid=1384868&ptid=349334][/url] 不知Altera指的是哪个IP，不妨找下Datasheet。 Xilinx对ENA信号的说明如下（高电平有效）： ------------------------------------------------ Optional Enable Pin The core provides optional port enable  ...
      请问 xilinx RAM Block 怎么看编号区分? 例如:RAMB16_S9 与 RAMB16_S18_S18      还是 SSR =0,是否会保留上一次的输出状态? [ 本帖最后由 keyway 于 2012-10-4 14:02 编辑 ]
    2. xilinx RAM Block "ENA" 问题? 9/6895 FPGA/CPLD 2012-10-03
      原帖由 仙猫 于 2012-10-3 15:03 发表 [url=https://bbs.eeworld.com.cn/redirect.php?goto=findpost&pid=1384747&ptid=349334][/url] ENA应该是使能/禁止A口时钟的控制信号，并非抑制输出。
      是高电平抑制输入吗?这与ALTERA 的 inclocken 是否一样?
    3. 求古董 IC 8279.VHD 是否有 4/2920 FPGA/CPLD 2012-10-02
      原帖由 仙猫 于 2012-10-1 04:29 发表 [url=https://bbs.eeworld.com.cn/redirect.php?goto=findpost&pid=1384303&ptid=349258][/url] 　看得懂VHDL的话编两句键盘扫描代码并非难事，何苦觅求老古董？即使真能找到8279.vhd，怎么和自己的代码连恐怕还得费折腾呢。
      没有太多时间看 8279 规格资料,如今只想做个小实验,验证一些动作.
    4. 新一代FPGA设计学习工具：Robei 5/3982 FPGA/CPLD 2012-09-30
      学习第一个步骤就是要有注册码:Mad:
    5. verilog 存储型寄存器组的问题以及分析 3/12370 FPGA/CPLD 2012-09-30
      altera使用Verilog写RAM 或 ROM 时,怎么选择内部RAM或LE?
    6. NVIC_SetPriority(SysTick_IRQn, 0x04) 144/41163 stm32/stm8 2012-06-08
      正学习，谢谢分享。

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