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1. 关于pspice仿真比较器不能正常工作的问题 6/15064 模拟电子 2018-05-23
  
  本帖最后由 18772964987 于 2018-5-23 10:48 编辑
  maychang 发表于 2018-5-23 10:23 “仿真的时候，结果如图所示，完全不一样” LM339输出是集电极开路方式，必须在输出端接电阻到电源正端 ...
  应该可以拉掉R88和地，只要加较大一点的上拉电阻就行了
2. 关于pspice仿真比较器不能正常工作的问题 6/15064 模拟电子 2018-05-23
  
  maychang 发表于 2018-5-23 10:23 “仿真的时候，结果如图所示，完全不一样” LM339输出是集电极开路方式，必须在输出端接电阻到电源正端 ...
  请问一下，是这样吗这样我感觉输出是R87和R88分压，要想使输出高电平即为比较器电源电压就须使上拉电阻R87相对于R88足够小，可以这样理解吗，谢谢！
3. 请问一下在Pspice或者Multisim中有没有一种压控开关，控制只在某一电压范围内（比.... 8/17706 模拟电子 2018-05-21
  
  qwqwqw2088 发表于 2018-5-20 08:40 压控开关可以试试这个适合电压控制分段，线性
  您真是经验老道的高手，上次关于FPGA的帖子，您也是给出来很实用的回复，对解决问题帮助很大，真心感谢！:congratulate:
4. 请问一下在Pspice或者Multisim中有没有一种压控开关，控制只在某一电压范围内（比.... 8/17706 模拟电子 2018-05-21
  
  chunyang 发表于 2018-5-19 20:58 并不存在这样的器件，自然仿真库内也不会有，所有仿真库器件都是有真实对应的，否则无意义，还仿个什么劲？
  是的，可以通过逻辑电路搭建出来！
5. 请问一下在Pspice或者Multisim中有没有一种压控开关，控制只在某一电压范围内（比.... 8/17706 模拟电子 2018-05-21
  
  qwqwqw2088 发表于 2018-5-20 08:40 压控开关可以试试这个适合电压控制分段，线性
  谢谢，我也在Multisim里面找到了，pspice里面没有这个，估计也没有实物，只是模拟器件！
6. AD650或者LM331--F/V转换 4/3579 TI技术论坛 2018-02-03
  
  qwqwqw2088 发表于 2018-2-2 20:17 实在不行就用protues仿真，有LM331模型 ADI官网找找AD650的
  ADI官网没有AD650的封装库，我们这个项目涉及的其他功能模块已经通过pspice仿真了，现在就差把f/v转换模块加进去，所以就卡在这么个封装问题上，您有什么办法帮忙解决吗，求教，谢谢！:congratulate:
7. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  maychang 发表于 2017-11-1 15:09 “我用的高频信号” 有多么高？1MHz？10MHz？100MHz？……
  就1M,信号源之后加了有源二阶滤波，还是滤不掉杂波
8. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  试过分频了效果不好，无奈之下才用的FPGA，是增加了成本{:1_118:}
9. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  gmchen 发表于 2017-11-1 14:55 我估计楼主要测的信号频率很高，单片机之类的速度跟不上了，所以才用FPGA。
  厉害了，果然被你看穿，单片机速度跟不上，我才加了FPGA模块，现在为了整形使计数更准确，硬件上加了施密特触发器:congratulate:
10. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  飞鸿浩劫发表于 2017-10-31 18:11 比较器分频器计数器
  比较器效果不好，除非用两个比较器，有两个阈值，像施密特触发器一样。。。
11. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  gmchen 发表于 2017-10-31 18:12 频率计，不是方波测不准，是不是测周期方式？将输入信号通过一个边沿触发器做2分频就可以得到方波了，只 ...
  一般低频测周期，高频计个数，我用的高频信号，所以计的信号脉冲个数，上升沿计数。。。
12. 利用FPGA运放将输入信号整形成一个占空比为50%的方波 19/5730 FPGA/CPLD 2017-11-01
  
  maychang 发表于 2017-10-31 18:06 FPGA？大材小用了吧？测量频率，不必整形成占空比50%的方波，只要波形不至于影响计数即可。
  就是波形不好，有杂波干扰，想着输入先通过施密特触发器再进入频率计效果可能会好些，但做模块，逻辑库里面好像没有施密特触发器吧，能不能做一个出来啊？
13. EP4CE6E22C8芯片的背面一个方形焊盘作用 8/5953 PCB设计 2017-10-13
  
  cruelfox 发表于 2017-10-13 16:25 手册上说了必须要接地。
  你在哪个手册上看到的，能不能发给我一份，或者截图都行，谢谢了！:)
14. EP4CE6E22C8芯片的背面一个方形焊盘作用 8/5953 PCB设计 2017-10-13
  
  cruelfox 发表于 2017-10-13 16:25 手册上说了必须要接地。
  不接地可以下载程序吗？我现在参考开发板设计了一块板子，也是用的这个芯片，但是背面这个焊盘悬空了，上电发现下载不了程序，不知道是不是这个影响的
15. 单片机空载即不下载程序时JTAG的TCK能产生方波吗 2/2562 FPGA/CPLD 2017-09-11
  
  lcofjp 发表于 2017-9-11 15:20 你那晶振是有源晶振，上电就振。
  我问的是端口TCK啊！
16. FPGA与单片机实现数据RS232串口通信的设计 7/3979 FPGA/CPLD 2017-09-07
  
  wsmysyn 发表于 2017-9-7 15:59 网上随便找一下破解器，按照说明操作就可以了。这里我就不传了，度娘一搜一堆一堆的
  好的，谢谢了！
17. FPGA与单片机实现数据RS232串口通信的设计 7/3979 FPGA/CPLD 2017-09-07
  
  wsmysyn 发表于 2017-9-7 15:42 应该是软件没有破解成功，有两个dll需要用破解器破解一下，才可以。
  我也觉得是没有破解成功，但是整个过程是按照助学板上面的教程安装破解的，而且显示破解成功了的，您说的有两个dll需要用破解器破解，能不能截图给我参考下，谢谢啦！

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