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pusher_yxg

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1. 关于FPGA实现DDS中DA的选型 16/8827 FPGA/CPLD 2011-11-30
  
  用IP直接做，理论上2X过采即可，我们经常使用2.5X过采的，如果考虑模拟部分设计，可适当提高，但是采样率4X足以。
2. Doulos ASIC Design and FPGA Design VHDL源代码 30/7961 FPGA/CPLD 2011-11-30
  
  学习一下先
3. Xilinx ISE Design Suite FPGA开发指南.逻辑设计篇[田耘著][... 64/17998 FPGA/CPLD 2011-11-30
  
  LZ好人，顶！
4. FPGA讨论贴及基础资料索引 63/25597 FPGA/CPLD 2011-07-07
  
  各位辛苦了
5. 【我给XILINX资源中心做贡献】EEWORD史上最全的FPGA论文集 57/12352 FPGA/CPLD 2011-07-07
  
  LZ太好了！

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