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1. 如何使用CPLD采集异步信号 3/4161 FPGA/CPLD 2021-01-28
  
  郝旭帅发表于 2020-10-10 18:26 如果频率固定的话，可以考虑采用过踩，然后恢复数据。
  能具体描述一下这个方法吗
2. 使用stc8系列做ADC多路采样时遇到某一路采样数据有时准确有时错误的情况 5/4199 51单片机 2020-09-19
  
  chunyang 发表于 2020-9-18 16:34 某一路是固定的一路还是多路中随机的一路？错误又是怎么个错误？要根据输入波形和采样点进行分析，最好先在 ...
  固定的一路，有时数据是准确的，有时数据又错误了，错误的数据是正确数据的一半
3. 使用stc8系列做ADC多路采样时遇到某一路采样数据有时准确有时错误的情况 5/4199 51单片机 2020-09-19
  
  maychang 发表于 2020-9-18 10:23 ADC的多路输入端并联到同一个稳定的电压源上，多路轮流转换，看看各路是否有所不同。如果仍有某一路间 ...
  不是该还有间歇性错误就是软件问题，没错就应该是硬件问题吗
4. 使用CPLD进行AES/EBU音频解码，解码出的数据出现了尖峰脉冲，是啥原因 5/4683 FPGA/CPLD 2020-08-18
  
  不足论发表于 2020-8-18 15:25 感觉是你同步没做好
  示波器测试波形，在音量很小的情况下，脉冲处的AES数据是正确的，在静音情况下，会有一个子帧的错位
5. 使用CPLD进行AES/EBU音频解码，解码出的数据出现了尖峰脉冲，是啥原因 5/4683 FPGA/CPLD 2020-08-18
  
  不足论发表于 2020-8-18 15:25 感觉是你同步没做好
  我这边是50MHZ做的一个计数去计数AES数据流的脉宽，然后根据脉宽向寄存器装相应的数据，当数据装够了，并且要等到I2S那边的左右时钟到来才会把寄存器的数据经I2S串行发送出去,请问一下您这个同步是指哪个地方呢
6. 使用CPLD进行AES/EBU音频解码，解码出的数据出现了尖峰脉冲，是啥原因 5/4683 FPGA/CPLD 2020-08-18
  
  不足论发表于 2020-8-18 14:51 自己的项目还是公司的？可以私聊协助解决
  公司的，目前就只有这个问题

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