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1. 怎样将FPGA的一个时钟信号变成多个时钟信号，求救啊 8/2830 EE_FPGA学习乐园 2014-03-06
  
  dongkun 发表于 2014-3-5 00:02 写个组合逻辑的直接连的模块就好了啊。把三个输出引到三个脚上。
  我试试吧
2. 怎样将FPGA的一个时钟信号变成多个时钟信号，求救啊 8/2830 EE_FPGA学习乐园 2014-03-04
  
  kdy 发表于 2014-3-4 12:36 PLL DCM都行看使用什么芯片
  哦我只是想做个软甲仿真，至于硬件那方面，现在还没有考虑。原来是驱动一个芯片，现在需要驱动3个芯片，而且是3个芯片交替工作那种。望前辈教诲。
3. 怎样将FPGA的一个时钟信号变成多个时钟信号，求救啊 8/2830 EE_FPGA学习乐园 2014-03-04
  
  白丁发表于 2014-3-4 12:36 你是要干什么用呢，直接用这一个不就是了
  之前用FPGA驱动一个芯片，现在需要驱动3个一样的芯片，不是需要将FPGA的时钟信号分成3个嘛？
4. 怎样将FPGA的一个时钟信号变成多个时钟信号，求救啊 8/2830 EE_FPGA学习乐园 2014-03-04
  
  晚辈在这里不胜感激啊。。。
5. Verilog HDL 任意整数分频 7/10875 FPGA/CPLD 2014-03-03
  
  谢谢分享
6. FPGA分频方面的资料 108/27246 FPGA/CPLD 2014-03-03
  
  谢谢分享

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