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1. FPGA的动态可重构 5/3173 FPGA/CPLD 2012-04-03
  
  其实就是两个可重构配置文件，存储在FPGA中，目标就是可以在不断电情况下用第一个FPGA发出命令，控制第二个实时配置，改变逻辑功能。我现在把两个重构件弄好了，打算用编写状态机，来处理第一个FPGA的命令，实现对被控FPGA的配置，但现在我不知道对FPGA进行配置的命令的verilog 代码怎么写
2. 【设计工具】xilinx好用的状态机编写软件StateCAD，里边有2个应用实例 48/11958 FPGA/CPLD 2012-04-01
  
  希望好用吧，最近应该用得着
3. FPGA的动态可重构 5/3173 FPGA/CPLD 2012-04-01
  
  有人帮助俺吗？？？
4. 【设计工具】《深入浅出玩转FPGA》PDF 光盘资料 2775/223343 FPGA/CPLD 2012-03-31
  
  感谢楼主分享

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