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PCB设计
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PCB设计
2011-12-15
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聊聊、笑笑、闹闹
2011-12-15
12.15 繁忙的一天又开始了
protell99se如何修改rule,来减小splitplane边界和via最小距离?
1/4707
PCB设计
2011-12-15
可以在rule----clearance constraint 里面,点击ADD,增加你的过孔和线间距之间的规则,你可以设成5Mil之类的,然后选择这个规则,不用其它的,如果画好这部分,再选择其他的规则,估计可以,还有一个方法就是如果你觉得这个不影响设计,就直接忽略掉DRC,不报警也没关系的。
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