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1. 用DSP进行语音压缩的一个开发实例 220/34426 DSP 与 ARM 处理器 2014-02-25
  
  啥都不会
2. DSP系统设计100问希望对大家有用 2103/258856 DSP 与 ARM 处理器 2014-02-25
  
  :):):):)
3. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/752907 FPGA/CPLD 2012-07-06
  
  夏老师，用状态机取出它与本地时钟同步的变化是什么意思啊，实现起来的思路是怎样的？我只会用脉冲边沿检测的方法来同步，感觉它的本质就是用几级寄存器实现的。
4. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/752907 FPGA/CPLD 2012-07-04
  
  夏老师，像这种数据流跨时钟域可以用FIFO来解决，那么控制信号跨时钟域也用FIFO么，我看有的资料上写的是用两级寄存器来解决。
5. 你问我答，【夏宇闻老师专栏】与你一起探讨FPGA设计！ 1776/752907 FPGA/CPLD 2012-06-29
  
  那一个module块里面用多个时钟，这样的代码风格是不是也不好？这样是不是涉及到跨时钟域问题？还想问一下夏老师，同步时钟的概念，先谢谢了~
6. 【设计工具】《片上系统设计思想与源代码分析》光盘很好的verilog学习资料 1010/92149 FPGA/CPLD 2012-05-24
  
  呵呵
7. writing_testbenches_2rd 好书分析 453/55522 FPGA/CPLD 2012-05-23
  
  哈哈~
8. 【设计工具】《深入浅出玩转FPGA》PDF 光盘资料 2775/203645 FPGA/CPLD 2012-03-19
  
  顶啊
9. 时序仿真问题 5/2948 FPGA/CPLD 2011-12-09
  
  什么意思，就是测试激励文件一样么？
10. 时序仿真问题 5/2948 FPGA/CPLD 2011-12-07
  
  没人知道么。。。:Cry:

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