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1. 逻辑综合器的故事 21/17301 FPGA/CPLD 2010-05-14
  
  原帖由 HDLWorld 于 2009-8-5 17:41 发表 [url=https://bbs.eeworld.com.cn/redirect.php?goto=findpost&pid=212457&ptid=77903][/url] 要说Synplicity公司的产品性能，那还是不错的。但关键是选错了对手。最初，S公司还不是很在意，由着他们去折腾。所以Synplicity公司的产品有两年还真的很火，到处推销，同时，还喜欢在客户那里把两家的产品都拿来比 ...
  现在一直用synplify，心在滴血啊~~
2. 《FPGA三国志》什么是“先组合后时序”思维 8/6465 FPGA/CPLD 2010-05-14
  
  真的有点晕啊，能不能举个例子说明一下啊~
3. 【社区大讲堂】如何在FPGA设计环境中加时序约束 48/45543 FPGA/CPLD 2010-05-13
  
  是不是牛人都用脚本加约束啊？我用的是synplify，挺方便的
4. 【社区大讲堂】如何在FPGA设计环境中加时序约束 48/45543 FPGA/CPLD 2010-05-13
  
  是不是高手都用这种脚本的方式加约束啊？我都用synplify，是不是有点小儿科？
5. 【社区大讲堂】如何在FPGA设计环境中加时序约束 48/45543 FPGA/CPLD 2010-05-13
  
  是不是高手都用这种脚本的方式加约束啊？我都用synplify，是不是有点小儿科？

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