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日志
quartus中调用双端口双时钟RAM
已有 2261 次阅读
2014-4-15 13:44
|
fpga
,
RAM
在quartus中的RAM可以加寄存器输出,也可以不加寄存器的输出。如果在输出端口加了一级的寄存器,那此时要注意你给出一个输出地址,它不是在这个地址的上升沿就将数据读出,而是下一个时钟周期将数据读出,即延时一个时钟周期。此方法可以避免产生尖峰脉冲。
在quartus中的RAM器输入则没有影响,如果其给出一个输入地址和输入数据,然后再来一个上升沿即可将该地址对应的数据读入,无延时。
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