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执古之道，以御今之有，能知古始，是谓道纪

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  • 2023-12-06

  • 发表了主题帖： 管理能产生效益吗？

    管理能产生效益吗？有的人认为能，比如IBM就兜售自己的所谓管理方法，也有不少大公司去购买。乔布斯对IBM的流程就提出了尖锐的批评，在乔布斯看来，组织流程和管理制度不是不重要，但企业必须清楚它们的定位是什么，它们必须是为产品创新提供服务的，不能主次颠倒。 最近一段时间被迫用mentor EE做项目，已经感受到了什么叫繁琐的流程。  mentor EE这个软件，与其说是一个PCB设计软件，不如说是一个流程管理软件。 软件本身遵循一套固定的流程， 而且mentor公司好像对自己的流程有一种异常的迷之自信，具体来说就是异常的繁琐， 而且做事的步骤，方法都是固定的， 功能却像是远古时代一样,  这种东西对高管来说就是十全大补丸，是灵丹妙药。  但是对干活的人来说就是天大的灾难。

  • 回复了主题帖： 一个英特尔的网卡方案原理图，可读性非常高

    damiaa 发表于 2023-12-6 09:37 2011年的图纸，现在看起来还是很好
    毕竟是大厂，还是很注意原理图规范的，英伟达的产品原理图也是类似的风格，可读性很高

  • 回复了主题帖： 【转载】最贻害无穷的画图方式！

    dukedz 发表于 2023-12-6 15:19 不太认可，接线太多反而太乱，眼花缭乱 最好还是按照功能多分几个子图，然后标号命名要讲究一些，和写代 ...
    乱吗？没有吧，这里这么多线都没眼花缭乱  

  • 回复了主题帖： 【转载】最贻害无穷的画图方式！

    dukedz 发表于 2023-12-6 15:19 不太认可，接线太多反而太乱，眼花缭乱 最好还是按照功能多分几个子图，然后标号命名要讲究一些，和写代 ...
    凡事都不能走极端，这里说的是能用线连的就用线连。要是全用线连了之后会很乱，那肯定要另想办法啊， 元件太大就做成分裂元件，连线交叉太多就考虑引脚排列，总是有办法的。你net label满天飞，图都没法看了，板子大了之后自然问题就多

  • 回复了主题帖： 请教，altium designer怎么给多层焊盘（接插件）单独设置铺铜规则？

    直接将表层的的覆铜的规则都改成通孔十字连接，其他覆铜默认全连接就行了

  • 2023-12-04

  • 回复了主题帖： 用栅极驱动器驱动MOS,MOS发热严重，表面测量温度达到90℃以上。这种情况可以从哪些...

    真的需要1.7M 200V吗

  • 2023-12-03

  • 回复了主题帖： 一个英特尔的网卡方案原理图，可读性非常高

    wang12011201 发表于 2023-12-2 18:50 整洁、规范， 没有net label到处乱飞，看这种图非常的舒适？？   ...

  • 2023-12-02

  • 回复了主题帖： 学pcb，现在用什么工具简单上手快的？

    当然是AD了，AD有可能是操作逻辑最贴近Windows系统的PCB软件了，比较直观、自由、易学易用。 设计多层板也没什么问题，别听网上那些人说什么AD画不了高速板之类的，那是一本正经的胡说八道，人云亦云

  • 回复了主题帖： 【转载】最贻害无穷的画图方式！

    器铭123 发表于 2023-12-2 10:13 我觉的你没说到点子上，你第一张图是比较复杂的，只能通过网络好连接；你后面举的例子，原理图都是比较简单 ...
    除了连接器没办法只能用Net Label来连接，其他的很多模块都是可以不用Net也能用线连接起来。 可以看一下TI和Intel这些大厂的参考设计，也基本上是能不用Net就不用      

  • 2023-12-01

  • 回复了主题帖： 漫谈电路、信号处理中的“虚部”

    简单理解一下，考虑电容电感电阻因素的时候，电流是一个实部虚部都不为0的复数，看成一个矢量。纯电阻的情况下，虚部为0，电流值和频率无关，电流波形没有相移。非纯电阻的情况下，虚部不为0，电流值和频率有关，而且有相移。所以这里的虚数单位 j 就是表示相移90°， jωL就相当于在ωL那么大的电阻阻值的基础上再让波形移相90°，电阻也是类似的移相90°，只不过是前移和后移的区别

  • 发表了主题帖： 一个英特尔的网卡方案原理图，可读性非常高

    英特尔的网卡参考设计原理图，虽然是黑白的，但还是能看得出来这个原理图画得很整洁、规范， 没有net label到处乱飞，看这种图非常的舒适      

  • 回复了主题帖： 有没有利用废旧内存条做成硬盘的方案

    lugl4313820 发表于 2023-12-1 07:30 内存条做硬盘，很久以前就可以了呀，无盘技术用的就是这个，不过性价比不高，一个后备电源就让你破产！
    无盘技术应该不是这个意思吧

  • 回复了主题帖： 有没有利用废旧内存条做成硬盘的方案

    qwqwqw2088 发表于 2023-12-1 07:35 问题是废旧内存条整合到一起不好匹配吧 内存的容量大小和频率不一定兼容
    现在一手的品牌DDR3内存条也挺便宜的

  • 回复了主题帖： 有没有利用废旧内存条做成硬盘的方案

    吾妻思萌 发表于 2023-12-1 06:41 你搜搜傲腾内存，现在已经gg了吧
    还是有差别

  • 回复了主题帖： 【转载】最贻害无穷的画图方式！

    fjdeepblue 发表于 2023-11-30 20:41 同一个电路模块，还是尽量用连线画清楚，net也是免不了，都不用net, 连线太多，也会看得头晕。
    可能还是要尽量避免像图一那样吧，像连接器和IC互联的情况，就实在没办法才用net label

  • 2023-11-30

  • 发表了主题帖： 有没有利用废旧内存条做成硬盘的方案

    虽然说SSD现在鼓吹的读写速度很高，但是都是顺序读写一些大文件， 4K以下的小文件随机读写应该还是比不上内存条的。现在DDR3 内存条很便宜，要是洋垃圾就更便宜了，能不能用某种技术将这些便宜内存条插在一块板子上，做成一个硬盘，再加点电池保证断电保存数据，用起来应该比SSD更快  

  • 回复了主题帖： 【转载】最贻害无穷的画图方式！

    虽然有些地方说得夸张了一点，但是总体上说得还是很有道理的，尤其是帮同事检查原理图的时候更是感同身受

  • 发表了主题帖： 【转载】最贻害无穷的画图方式！

    本文转载自WX公众号 电子森林，作者苏老师，原文链接https://mp.weixin.qq.com/s/tbb46ixtI6Jh1FehqHY3Cw   几天前看一专业微信大号标题“必须收藏：原理图设计规范126条checklist“，点了进去，没想到标题下、所有内容前是如下的这么个电路图，后面的126条我一点读下去的兴趣都没了。   看官们会说“why”，“我觉得这图画的很好啊”，“苏老师您觉得这图哪里不好？”，这正是我在微信朋友圈里贴出去之后获得的纷纷反应，更感觉这样的电路图给年轻人的贻害之深，我觉得太需要写一篇文章来说说这事了，无奈前几天都在连载时钟方面的文章，直到今天才抽出空来说一下了。   首先我问大家个问题：原理图画了是给谁看的？ 90%以上的人会说，当然是自己看的了，自己做的设计，自己画的图嘛。苏老师要说  ---  错❌！原理图是自己画的，但不仅仅是给自己看的，更重要的是给其他人看，给机器（画图的工具软件）看！公司的其它同事、你的客户、帮你做Layout的工程师拿到你这张图，能很容易看得懂吗？显然很难看懂，至少要花很多时间琢磨才能看懂，太不直观了！比如你第一次到北京去旅游，下车你买了一份北京地图，每个区都分割成了块 - 海淀区、朝阳区。。。每个区的每条马路都用路名标示，你可以根据路名找到它们之间的连接关系。。。   我相信你拿着这样的地图一定会原地崩溃的，如果画图人在你面前，估计你抽他一巴掌的心都有。。。   其他人拿到你这样画的电路图也会有这种烦躁的心情的，别说替你Review了，根本就没心情去仔细看，Layout的工程师要根据你提供的原理图来做布局布线，估计他一边连线，一边骂你。   你会问 - 我画的图为什么要让他们看呢？这就是你的局限了，如果你一辈子都是在小公司里一个人玩硬件设计，这是OK的，你要想去BroadCom、想去华为，就这样的电路图拿出来，估计面试你的项目经理让你立马走人，因为你根本就没有Teamwork、Project flow这方面的意识。   你会问，那机器怎么就读不懂了？ 从原理图到布局布线之间有个桥梁叫Netlist，这个netlist就是基于你原理图上的连接以及net名字，这里面就会存在着高度的风险 - 你认为A器件的管脚15跟B器件的管脚3都用了同一个net名字“Data3”，可是你在添加net name的时候手一哆嗦，把A器件管脚15的名字写成了Data8，由于页面上的net name太多，你也没有留意到这个错误，机器在生成netlist的时候并没有将这两个管脚俩连接起来，等你拿到板子花了两周的时间怎么也调试不出来的时候才发现这俩net名字标记错了，想飞线还飞不了， 因为器件是BGA的封装，你的脸估计都成“平方”了。       你会说，我不会这么倒霉吧？毕竟是小概率事件啊，我也会认真查找的啊。哎，要知道小概率事件是会经常发生的，这是一个定律！你越是认为不可能出现的事情越容易出现，而且一出现就是大问题。即便这次侥幸没遇到，迟早有一天会让你吃尽苦头的。   你还会说，工具软件中不是有ERC检查么？我用ERC查一下不就好了。现在的工程师有多少人养成了每次都用ERC，并对ERC每行、每行都仔细检查的习惯？何况有的net名字拼写错误ERC未必能检查出来啊，比如在电路图上有多个VDD、VCC、VSS，你用错了其中一个，这些net是都在的，ERC是不报错的，但你确实连错地方了。   所以，第一张图，从别人理解的角度、从机器阅读的角度都是极不友好的，即便是对自己，检查每根信号线的连接也是一件非常费时费力的事情，总体上来讲对谁都不好。   有人会说，苏老师我同意你的说法，但这张图是针对开发板的，方便开发板用户使用才这么做的。那就更不应该了，因为很多用开发板的工程师以初学者居多，他们看到啥学啥，这种图、放在这么重要的一篇有理有据的文章的前面，给工程师产生的影响一定是非常大的，很容易让没有经验的工程师模仿这种做法，从而养成坏习惯。   那么，怎样才是比较好的电路图呢？我们看下面的一个跟我们小脚丫FPGA学习模块长得很像的MCU控制模块叫Teensy，3.6版本（网上可以搜到它的很多资料）：       它的电路图是这个样子的：       是不是感觉非常清晰？看起来一目了然？而这个图中基本上没有用net进行信号的连接，基于这个原理图做的PCB布局布线出错的可能性也就大大降低。   总之，记住苏老师的两个观点： 原理图最重要的是要让别人凭着直觉就能一下子看懂，设计任何产品的时候都不能只是站在自己的立场上看问题，要更多地想想别人会怎么解读； 在原理图的绘制中要尽可能不用net来进行信号线的连接，实在没有办法的情况下用net也是可以的，但一定要反复检查，尤其是将ERC、Netlist打印出来进行检查，不要完全相信电脑上用眼看到的东西。   最后分享一个我们Hackaday的工程师设计的一个小产品的原理图：    

  • 回复了主题帖： 又中招了，同事相继感染，我也没有幸免

    我也中招了，鼻塞流鼻涕已经一周多还没好，现在慢慢开始咳嗽，像是感染了金黄色葡萄球菌之类的东西

  • 回复了主题帖： 有人试过用洗板水来清理顽固油污吗

    wangerxian 发表于 2023-11-30 10:33 办公室，密封的。有抽风机，不过依旧排在室内，今天鼻子难受，感冒的感觉。
    跟空调外机装在室内一样， 这时候的抽风机可能还不如没有，不仅排不出去，还把有害气体扩撒均匀

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